LQFP-32 STM8S105K4T6C a enfoncé IC processeur-contrôleur

Description de produit

STM8S105K4T6C a enfoncé les contrôleurs STM8S STM8S105 STM8S105K STM8S105K4 STM8S105K4T6 IC MCU de processeurs

TM8S105C4/6 STM8S105K4/6 STM8S105S4/6

Ligne d'accès, 16 mégahertz STM8S MCU à 8 bits, éclair de jusqu'à 32 K bytes, EEPROM intégré, 10 bit CDA, minuteries, UART, SPI, ² C d'I

Description

La ligne d'accès STM8S105x4/6 microcontrôleurs à 8 bits offrent de l'éclair de 16 à 32 K bytes
mémoire de programme, plus les données vraies intégrées EEPROM. La famille de microcontrôleur de STM8S
le manuel de référence (RM0016) se rapporte à des dispositifs dans cette famille comme milieu-densité. Tous les dispositifs
de la ligne d'accès STM8S105x4/6 fournir les indemnités suivantes : coût du système réduit,
représentation et robustesse, cycles de développement courts, et longévité de produit.

Le coût du système est grâce réduite à des données vraies intégrées EEPROM jusqu'à de 300 k
écrivez/cycles d'effacement et un niveau élevé d'intégration de système avec des oscillateurs d'horloge interne,
chien de garde et remise d'arrêt partiel.

La représentation de dispositif est assurée par une fréquence du signal d'horloge d'unité centrale de traitement de 16 mégahertz et augmentée
caractéristiques qui incluent l'entrée-sortie robuste, chiens de garde indépendants (avec une horloge distincte
source), et un système de sécurité d'horloge.

Les cycles de développement courts sont dus garanti à l'évolutivité d'application à travers le terrain communal
architecture de produit de famille avec le pinout compatible, la carte mémoire et les périphériques modulaires.
La longévité de produit est assurée dans grâce de famille de STM8S à leur noyau avancé qui est
fait en technologie de pointe pour des applications avec l'approvisionnement d'opération de 2,95 V à de 5,5 V.
La pleine documentation est offerte aussi bien qu'un choix large des instruments de développement.

Caractéristiques
Noyau
le  16 mégahertz a avancé le noyau STM8 avec Harvard
canalisation d'architecture et de 3 étapes
jeu d'instructions prolongé de 

Souvenirs
mémoire de programme de  : éclair de jusqu'à 32 K bytes ; données
conservation 20 ans au °C 55 après le kcycle 10
mémoire de données de  : jusqu'à 1 données vraies de K byte
EEPROM ; kcycle de la résistance 300
 RAM : K byte jusqu'à 2
Gestion d'horloge, de remise et d'approvisionnement
tension d'opération de V du  2,95 à 5,5
contrôle flexible d'horloge de , 4 sources d'horloge principale
– Oscillateur en cristal de résonateur de puissance faible
– Entrée d'horloge externe
– Interne, utilisateur-trimmable 16 mégahertz RC
– 128 kilohertz de basse puissance internes RC
système de sécurité d'horloge de  avec le moniteur d'horloge
le  actionnent la gestion :
– Modes de basse puissance (attente, actif-halte, halte)
– Horloges périphériques de commutateur- individuellement
 de manière permanente actif, puissance de bas-consommation
sur et de puissance-vers le bas remise
Gestion d'interruption
contrôleur d'interruption niché par  avec 32 interruptions
 jusqu'à 37 interruptions externes sur 6 vecteurs

Minuteries
minuterie de contrôle avancé de  : de 16 bits, 4 CAPCOM
canaux, 3 sorties complémentaires, mort fois
insertion et synchronisation flexible

minuterie d'usage universel du  2x16-bit, avec 2+3
Canaux de CAPCOM (IC, OC ou PWM)
minuterie de base à 8 bits de  avec le prescaler à 8 bits
l'automobile de  réveillent la minuterie
chien de garde de fenêtre de  et chien de garde indépendant
minuteries

Interfaces de communication
 UART avec la sortie d'horloge pour synchrone
opération, carte à puce, IrDA, mode principal de LIN
interface de SPI de  jusqu'à 8 Mbits/s
interface du  I2C jusqu'à 400 Kbits/s
Convertisseur analogique-numérique (CDA)
 10-bit, ±1 LSB CDA avec jusqu'à 10 multiplexés
canaux, mode de balayage et chien de garde analogue
I/Os
 jusqu'à 38 I/Os sur un paquet de 48 bornes comprenant le 
16 sorties élevées d'évier
conception fortement robuste d'entrée-sortie de , immunisée contre
injection actuelle

Identification unique
clé unique du  96-bit pour chaque dispositif

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